Procédé et dispositif à processeur de signaux numériques pour la mise en Óoeuvre d'un algorithme de Viterbi.

Abstract

Ce dispositif comprenant un processeur de signaux numériques (1) proprement dit, une mémoire ROM (2) de programme et une mémoire RAM (3) de données reliées respectivement au processeur, est caractérisé en ce qu'à la mémoire RAM de données est associée une mémoire RAM de Viterbi (7) comportant des moyens d'exécution des opérations d'addition, de comparaison et de sélection de l'algorithme de Viterbi, et une logique (8) de commande de la mémoire RAM de Viterbi (7).

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    Patent Citations (4)

      Publication numberPublication dateAssigneeTitle
      JP-S60173930-ASeptember 07, 1985Fujitsu LtdPipeline processing viterbi decoder
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    NO-Patent Citations (5)

      Title
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    Cited By (0)

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